So ersetzen Sie fragile „Zwiebellogik“ durch SPS-Zustandsautomaten

Um fragile Zwiebellogik in SPS-Programmen zu ersetzen, sollten Ingenieure explizite endliche Zustandsautomaten (Finite State Machines) verwenden. Eine Zustandsautomaten-Architektur kann Mehrdeutigkeiten in der Scan-Reihenfolge reduzieren, die Fehlerbehandlung isolieren und das Testen unter anormalen Bedingungen in der Simulation beobachtbar machen, bevor die Logik einen realen Prozess erreicht.

Ein weit verbreitetes Missverständnis ist, dass Ladder-Logik „fortgeschritten“ wird, wenn sie komplexer wird. In der Praxis ist Komplexität oft nur Mehrdeutigkeit in Arbeitskleidung. Maschinen versagen nicht, weil ein Netzwerk raffiniert aussah; sie versagen, weil der Ablauf nicht deterministisch war, als ein reales Eingangssignal im falschen Moment wechselte.

Während eines internen Benchmarks von 200 nutzerseitig eingereichten Mischsequenz-Übungen im OLLA Lab gerieten 82 % der tief verschachtelten „Zwiebellogik“-Programme in eine nicht wiederherstellbare Sequenzblockade, wenn sie einem 100-ms-Ereignis eines intermittierenden Sensorausfalls ausgesetzt wurden. Im Gegensatz dazu erholten sich refactorte Versionen mit expliziten Zuständen in 100 % derselben Tests deterministisch [Methodik: n=200 eingereichte Mischsequenz-Aufgaben, Vergleich = ursprüngliche verschachtelte Latch-Implementierung versus refactorte explizite Zustandsimplementierung, Zeitfenster = Ampergon Vallis Lab interner Review-Zyklus abgeschlossen Q1 2026]. Dieser interne Benchmark stützt einen spezifischen architektonischen Punkt: Explizite Zustandsmodelle waren unter den getesteten Bedingungen fehlerresistenter. Er stützt keine pauschalen Aussagen über alle SPS-Codes, alle Branchen oder die Kompetenz von Bedienern.

Der praktische Unterschied ist einfach: Syntax ist nicht gleich Einsatzbereitschaft. Ein Programm, das im Idealfall funktioniert, aber bei einem flackernden Freigabesignal einfriert, ist nicht bereit für die Inbetriebnahme – egal wie ordentlich die Netzwerke aussehen.

Zwiebellogik ist ein Anti-Pattern der Ladder-Logik, bei dem das Maschinenverhalten durch Schichten voneinander abhängiger Booleans, verstreuter Latches und verschachtelter Freigaben gesteuert wird, deren kombinierter Ausführungspfad unter anormalen Bedingungen schwer nachvollziehbar ist.

Der Name ist informell, aber der Fehlermodus ist real. Jede neue Bedingung legt sich wie eine Schale um die vorherige, bis der Ablauf von versteckten Wechselwirkungen zwischen Netzwerkreihenfolge, Latch-Historie und transienten Eingangssignalen abhängt. Während Vorführungen funktioniert es meistens. Die Inbetriebnahme ist weniger nachsichtig.

Die 3 Symptome von Zwiebellogik

Der Fortschritt des Ablaufs hängt von mehreren `(S)/(R)`- oder `(OTL)/(OTU)`-Befehlen ab, die über viele Netzwerke verteilt sind, oft ohne eine einzige maßgebliche Quelle für den Maschinenzustand.

• Voneinander abhängige Latches

Das Programmverhalten ändert sich je nach Netzwerkreihenfolge, Timing innerhalb eines Scans oder davon, ob eine Freigabe vor oder nach der Auswertung einer Rücksetzbedingung abfällt.

• Anfälligkeit für den Scan-Zyklus

Der Ablauf läuft korrekt, solange jeder Sensor einwandfrei funktioniert, blockiert aber, bleibt halb verriegelt oder erfordert nach einer Unterbrechung mitten im Zyklus ein manuelles Zurücksetzen.

• Bias für den Idealfall (Happy-Path)

Warum Zwiebellogik fragil wird

Zwiebellogik erhöht die effektive zyklomatische Komplexität. Einfach ausgedrückt: Die Anzahl der möglichen Ausführungspfade wächst schneller, als ein Junior-Ingenieur sie unter Fehlerbedingungen zuverlässig nachverfolgen kann, insbesondere wenn mehrere Booleans aus vorherigen Scans auf „wahr“ bleiben können.

Das ist wichtig, weil die Fehlersuche an einer SPS nicht im luftleeren Raum stattfindet. Sie geschieht, während ein Förderband steht, eine Pumpe nicht verfügbar ist oder ein Chargenschritt auf eine Freigabe wartet, die „eigentlich wahr sein sollte“. „Sollte“ ist keine Diagnosemethode.

Explizite Zustandsautomaten bieten eine bessere Fehlerbehebung, weil sie die Absicht der Maschine eindeutig, beobachtbar und deterministisch machen. Zu jedem Zeitpunkt befindet sich die Maschine in einem definierten Zustand, und Übergänge erfolgen nur, wenn explizite Bedingungen erfüllt sind.

Dies ist der entscheidende architektonische Unterschied. Zwiebellogik fragt: „Welche Ansammlung von Bits impliziert aktuell, wo ich mich befinde?“ Ein Zustandsautomat fragt: „In welchem Zustand bin ich, und welche Bedingung erlaubt den nächsten?“ Die zweite Frage ist um 3 Uhr morgens wesentlich einfacher zu beantworten.

### Operative Definition: Was ist ein expliziter Zustandsautomat in Ladder-Logik?

Ein expliziter Zustandsautomat ist eine Steuerungsarchitektur, bei der:

• der Sequenzstatus einer Maschine durch eine einzelne maßgebliche Zustandsvariable repräsentiert wird, oft ein Integer;
• jeder Zustand exklusiv gegenüber den anderen ist;
• Übergänge explizit durch beobachtbare Bedingungen definiert sind;
• anormale Bedingungen die Maschine in einen definierten Fehler- oder Haltezustand leiten;
• physikalische Ausgänge aus dem aktiven Zustand abgeleitet werden, anstatt über unzusammenhängende Sequenznetzwerke verstreut zu sein.

Ein einfaches Beispiel könnte verwenden:

• `0 = Leerlauf`
• `10 = Starten`
• `20 = Betrieb`
• `30 = Stoppen`
• `99 = Fehler`

Dieser Ansatz entspricht den etablierten Prinzipien der Softwarestrukturierung gemäß IEC 61131-3, die eine strukturierte Programmorganisation, ein klares Ausführungsverhalten und wartbare Steuerungslogik unterstützt. Die Norm schreibt kein universelles Sequenzmuster für jede Maschine vor, aber die Bevorzugung einer expliziten, lesbaren Architektur ist unumstritten.

Expliziter Zustand vs. Zwiebellogik

| Aspekt | Expliziter Zustandsautomat | Zwiebellogik | |---|---|---| | Zustandsrepräsentation | Eine maßgebliche Zustandsvariable, meist Integer-basiert | Viele überlappende Booleans und Latches | | Sichtbarkeit des Ablaufs | Aktuelle Maschinenphase ist direkt beobachtbar | Sequenzposition muss abgeleitet werden | | Fehlerbehandlung | Expliziter Sprung in einen definierten Fehler- oder Haltezustand | Fehlerbehebung hängt vom Rücksetzen der richtigen Bedingungen ab | | Ausgangszuordnung | Ausgänge werden in einer dedizierten Routine aus dem aktiven Zustand abgeleitet | Ausgänge oft über Sequenznetzwerke verstreut | | Fehlersuche | Frage: „Warum wechselte Zustand X nicht zu Y?“ | Frage: „Welches Bit wurde nicht gesetzt oder zurückgesetzt?“ | | Sensitivität der Scan-Reihenfolge | Reduziert, wenn Übergänge sauber partitioniert sind | Oft hochsensibel gegenüber der Netzwerkreihenfolge | | Wartbarkeit | Einfacher zu prüfen, zu testen und zu überarbeiten | Verschlechtert sich schnell, wenn Bedingungen akkumulieren |

Zwiebellogik versagt unter realem Scan-Zyklus-Verhalten, weil SPSen keine Absichten auswerten; sie werten Anweisungen der Reihe nach aus, einen Scan nach dem anderen, unter Verwendung des aktuellen Zustands von Speicher und Eingängen.

Das klingt offensichtlich, aber viele Sequenzfehler sind nur eine verspätete Erkenntnis dieser Tatsache. Ein Sensor kann für 50 ms abfallen. Eine Rückmeldung kann einen Scan später als erwartet eintreffen. Ein Latch kann gesetzt bleiben, weil das Rücksetz-Netzwerk unter der exakten Abfolge der Ereignisse, die eingetreten sind, nie „wahr“ wurde.

Typische Fehlermechanismen

Ein Übergangsbit setzt und rücksetzt in benachbarter Logik, was die nachgelagerte Sequenzlogik in einem unbestimmten Zustand hinterlässt.

• One-Scan-Rennen

Ein Sequenzschritt bleibt wahr, weil der Rücksetzpfad von einer Freigabe abhängt, die während des Fehlers verschwand.

• Persistenz von Latch-Speichern

Das Verschieben eines Netzwerks zur besseren Lesbarkeit ändert das Verhalten, weil die Logik auf impliziter Ausführungsreihenfolge statt auf expliziten Zustandsübergängen beruhte.

• Abhängigkeit von der Netzwerkreihenfolge

Ein verrauschtes oder kurzzeitig verlorenes Feldsignal führt dazu, dass die Maschine teilweise voranschreitet, dann aber die Bedingungen verliert, um entweder fortzufahren oder sich zu erholen.

• Sensorprellen oder intermittierender Verlust

Dies sind keine exotischen Randfälle. Es sind gewöhnliche Ereignisse auf dem Werksboden. Die Hardware ist nicht dazu verpflichtet, Ihr Sequenzdesign zu schmeicheln.

Sie bauen einen endlichen Zustandsautomaten in Ladder-Logik, indem Sie die Zustandsübergangslogik von der Ausgangsaktionslogik trennen. Die Übergangsroutine entscheidet, wann die Maschine den Zustand wechselt. Die Ausgangsroutine entscheidet, was die Maschine in diesem Zustand tut.

Diese Trennung ist die grundlegende Disziplin. Wenn Übergänge und Ausgänge überall vermischt werden, driftet die Architektur zurück zur Zwiebellogik.

### Schritt 1: Maschinenzustände definieren

Beginnen Sie mit der Zuweisung exklusiver Zustandswerte.

• `0 = Leerlauf`
• `10 = Startanforderung`
• `20 = Starten`
• `30 = Betrieb`
• `40 = Stoppen`
• `99 = Fehler`

Verwenden Sie eine Nummerierung, die Platz für spätere Ergänzungen lässt. Ingenieure, die jeden Zustand 1, 2, 3 nummerieren, treffen meist irgendwann auf Zustand 2.5.

### Schritt 2: Übergangsbedingungen definieren

Jeder Übergang sollte eine enge Frage beantworten:

• Welche Bedingung erlaubt den Eintritt in den nächsten Zustand?
• Welche Bedingung blockiert den Fortschritt?
• Welche Bedingung erzwingt einen Fehler- oder Haltezustand?
• Welche Bedingung erlaubt das Zurücksetzen oder die Wiederherstellung?

Übergänge sollten explizit und testbar sein. Vermeiden Sie versteckte Abhängigkeiten von Seiteneffekten aus unzusammenhängenden Netzwerken.

### Schritt 3: Übergangslogik zuerst schreiben

Unten ist ein kompaktes Beispiel im Ladder-Stil für Zustandsübergänge:

Sprache: Kontaktplan (Ladder Diagram) - Zustandsübergangslogik

Netzwerk 1: Leerlauf (0) -> Starten (10) EQU(Maschinen_Zustand, 0) --- XIC(Start_Taster) --- XIC(System_Bereit) --- MOV(10, Maschinen_Zustand)

Netzwerk 2: Starten (10) -> Betrieb (20) EQU(Maschinen_Zustand, 10) --- XIC(Motor_Lauf_Rueckmeldung) --- MOV(20, Maschinen_Zustand)

Netzwerk 3: Jeder aktive Zustand -> Fehler (99) bei Störung NEQ(Maschinen_Zustand, 0) --- XIC(Stoerung_Aktiv) --- MOV(99, Maschinen_Zustand)

Netzwerk 4: Fehler (99) -> Leerlauf (0) nach Reset und sicheren Bedingungen EQU(Maschinen_Zustand, 99) --- XIC(Reset_Taster) --- XIO(Stoerung_Aktiv) --- XIC(System_Bereit) --- MOV(0, Maschinen_Zustand)

Der wichtige Punkt ist nicht die exakte Syntax. Der wichtige Punkt ist, dass der aktuelle Zustand und die Übergangsbedingung sichtbar, singulär und überprüfbar sind.

### Schritt 4: Ausgänge aus dem Zustand abbilden, nicht aus Sequenzfragmenten

Eine separate Routine sollte Ausgänge aus dem aktiven Zustand ableiten.

Zum Beispiel:

• Wenn `Maschinen_Zustand = 20`, befehle `Motor_Lauf = 1`
• Wenn `Maschinen_Zustand = 40`, befehle `Motor_Lauf = 0`
• Wenn `Maschinen_Zustand = 99`, schalte nicht-sichere Ausgänge ab und setze Fehleranzeige

Dies reduziert verstreute Ausgangsspulen und macht das Maschinenverhalten leichter prüfbar.

### Schritt 5: Fehlerverhalten bewusst definieren

Ein Fehlerzustand sollte kein vager „Irgendetwas ist schiefgelaufen“-Behälter sein. Er sollte definieren:

• welche Ausgänge abgeschaltet werden,
• welche Alarme ausgelöst werden,
• ob der Neustart automatisch oder manuell erfolgt,
• welche Reset-Bedingungen erforderlich sind,
• und welche Nachweise der Bediener oder Ingenieur beobachten kann.

Deterministik ist am wichtigsten, wenn Dinge schiefgehen. Normalbetrieb schmeichelt schwacher Architektur.

„Simulationsbereit“ bedeutet, dass der Ingenieur die Steuerungslogik gegen realistisches Prozessverhalten in einer risikokontrollierten Umgebung beweisen, beobachten, diagnostizieren und härten kann, bevor diese Logik einen realen Prozess erreicht.

Dies ist eine operative Definition, kein Kompliment. Es bedeutet nicht „vertraut mit Ladder-Syntax“, „bereit für die Inbetriebnahme ohne Aufsicht“ oder „automatisch einstellbar“. Es bedeutet, dass der Ingenieur eine Sequenz anormalen Bedingungen aussetzen, das resultierende Verhalten untersuchen und die Logik auf Basis von Beweisen überarbeiten kann.

Beobachtbare Verhaltensweisen eines simulationsbereiten Ingenieurs

Ein simulationsbereiter Ingenieur kann:

• diskrete und analoge E/A erzwingen und überwachen;
• erwartetes Sequenzverhalten gegen beobachtete Maschinenreaktion vergleichen;
• einen Fehler injizieren, wie z. B. intermittierenden Sensorausfall oder fehlende Rückmeldung;
• verifizieren, dass die Logik in einen sicheren, definierten Zustand übergeht;
• Übergangsfreigaben oder Fehlerbehandlung überarbeiten;
• das Szenario erneut ausführen und ein verbessertes deterministisches Verhalten demonstrieren.

Das ist der Unterschied zwischen dem Schreiben von Code und dem Validieren von Steuerungsverhalten. Die Lücke ist teuer.

OLLA Lab simuliert Zustandsübergangsfehler, indem es Ingenieuren eine browserbasierte Ladder-Umgebung, Simulationssteuerungen, sichtbare Variablen und E/A sowie szenariobasierte digitale Zwillinge zur Verfügung stellt, die eine Fehlerinjektion ohne Risiko für die reale Ausrüstung ermöglichen.

Hier wird das Produkt operativ nützlich. Der Wert liegt nicht darin, dass es Ladder-Logik in einem Browser zeichnet. Viele Werkzeuge können zeichnen. Der Wert liegt darin, dass die Logik gegen simuliertes Ausrüstungsverhalten und anormale Bedingungen in einer geschlossenen Umgebung getestet werden kann.

Relevante OLLA Lab-Funktionen für die Zustandsautomaten-Validierung

Ingenieure können Zustandsübergänge unter Verwendung von Kontakten, Spulen, Timern, Zählern, Vergleichern, Mathematik, Logik und PID-bezogenen Anweisungen erstellen.

• Webbasierter Ladder-Logik-Editor

Logik kann ohne physische Hardware ausgeführt, gestoppt und beobachtet werden.

• Simulationsmodus

Tags, Eingänge, Ausgänge, Analogwerte und Zustandsvariablen können direkt überwacht und angepasst werden.

• Variablen-Panel und E/A-Sichtbarkeit

Ladder-Logik kann gegen simuliertes Ausrüstungsverhalten in realistischen Maschinen- oder Prozesskontexten verglichen werden.

• 3D / WebXR / VR-Simulationen

Der Ingenieur kann testen, ob die Sequenzlogik das beabsichtigte Ausrüstungsverhalten erzeugt, bevor eine Diskussion über den Live-Einsatz stattfindet.

• Validierungs-Workflow für digitale Zwillinge

Mehr als 50 benannte Presets aus den Bereichen Fertigung, Wasser/Abwasser, HLK, Chemie, Pharma, Lagerhaltung, Lebensmittel/Getränke und Versorgungsunternehmen bieten kontextspezifische Sequenzen, Gefahren und Verriegelungen.

• Szenariobasierte industrielle Presets

Ein praktischer OLLA Lab-Testfall

In einem Szenario mit Förderbandstau kann ein Ingenieur:

Das ist eine glaubwürdige Übungsaufgabe, weil sie eine reale Inbetriebnahmesituation widerspiegelt: Was passiert, wenn die Maschine nicht die saubere Signalabfolge erhält, die der ursprüngliche Autor angenommen hat?

1. `Maschinen_Zustand = 20` setzen, um Betrieb darzustellen;
2. das digitale Zwillings-Förderband in Betrieb beobachten;
3. eine Freigabe oder Rückmeldung mitten in der Sequenz über das Variablen-Panel abfallen lassen;
4. verifizieren, ob der Zustand zu `99 = Fehler` wechselt oder in einem inkonsistenten Zustand hängen bleibt;
5. die Übergangslogik überarbeiten;
6. das Szenario erneut ausführen, um die deterministische Wiederherstellung zu bestätigen.

Ingenieure sollten Zustandsautomaten-Fähigkeiten als kompakten Korpus an Ingenieursnachweisen dokumentieren, nicht als Screenshot-Galerie.

Ein Screenshot beweist, dass ein Bildschirm existierte. Er beweist nicht, dass die Logik korrekt, getestet oder nach einem Fehler überarbeitet wurde.

Erforderliche Nachweisstruktur

Verwenden Sie diese sechsteilige Struktur:

Geben Sie an, was erfolgreiches Verhalten in beobachtbaren Begriffen bedeutet: Startbedingungen, Ausgänge, Übergänge, Alarme, sicheres Stoppverhalten und Reset-Anforderungen.

Identifizieren Sie die eingeführte anormale Bedingung: Sensorausfall, fehlgeschlagene Rückmeldung, analoge Abweichung, Zeitüberschreitung, Stau, Not-Aus-Kettenunterbrechung oder Ähnliches.

Dokumentieren Sie die exakte Logikänderung: hinzugefügte Zeitüberwachung, überarbeitete Freigabe, expliziter Fehlerübergang, Entprellung, Ausgangs-Remapping oder Reset-Bedingung.

1. Systembeschreibung Definieren Sie die Maschine oder den Prozess, ihren Zweck und ihre Sequenzgrenzen.
2. Operative Definition von „korrekt“
3. Ladder-Logik und simulierter Ausrüstungszustand Zeigen Sie die Zustandsarchitektur, wichtige Tags und die entsprechende simulierte Ausrüstungsreaktion.
4. Der injizierte Fehlerfall
5. Die vorgenommene Überarbeitung
6. Gelernte Lektionen Erklären Sie, was der Fehler über die ursprüngliche Architektur enthüllte und warum die Überarbeitung die Deterministik oder Wiederherstellbarkeit verbesserte.

Diese Struktur ist nützlich, weil sie die ingenieurtechnische Argumentation überprüfbar macht. Arbeitgeber und leitende Prüfer benötigen kein Portfolio schöner Oberflächen. Sie benötigen Beweise, dass Sie Fehler durchdenken können.

Explizite Zustandsarchitektur wird indirekt durch etablierte Prinzipien der Steuerungssoftware und Sicherheitstechnik unterstützt, auch wenn die Normen kein exaktes Ladder-Muster vorschreiben.

Relevante Normen und technische Grundlagen

Unterstützt strukturierte Programmieransätze für industrielle Steuerungssoftware sowie eine klare Organisation von Logik, Funktionen und Ausführungsverhalten.

• IEC 61131-3

Betont systematische Integrität, Fehlerreaktion und die Bedeutung der Reduzierung gefährlicher Mehrdeutigkeiten im Design bei sicherheitsrelevanten Systemen.

• IEC 61508

Unterstreichen die Notwendigkeit für deterministisches Verhalten, Rückverfolgbarkeit und testbare Fehlerbehandlung im Design von Steuerungssystemen.

• exida-Leitlinien und Praxis der funktionalen Sicherheit

Aktuelle industrielle Literatur unterstützt konsistent die Simulation als Mittel zur Validierung von Verhalten, zur Reduzierung von Inbetriebnahmerisiken und zur Aufdeckung von Sequenzfehlern vor dem Einsatz, warnt jedoch gleichzeitig, dass die Simulationsqualität von der Modelltreue und dem Testdesign abhängt.

• Literatur zu digitalen Zwillingen und Simulation

Forschung in ingenieurtechnischen Trainingsumgebungen legt nahe, dass interaktive Simulation das prozedurale Verständnis und die Fehlererkennung verbessern kann, insbesondere wenn Lernende Ursache-Wirkungs-Zusammenhänge testen können, anstatt nur statische Beispiele zu lesen.

• Literatur zu immersivem und interaktivem Training

Die begrenzte Schlussfolgerung ist eindeutig: Simulation ersetzt keine Felderfahrung, aber sie ist ein vertretbarer Ort, um Fehlerlogik zu proben, die an einem realen Prozess unsicher, teuer oder unpraktisch zu testen wäre.

Zustandsautomaten sind keine Magie. Sie können immer noch schlecht entworfen, überkompliziert oder ohne ausreichende Aufmerksamkeit für das Verhalten im sicheren Zustand, die Modusverwaltung oder die Wiederherstellung durch den Bediener implementiert sein.

Häufige Fehler bei Zustandsautomaten

• zu viele Zustände ohne klare Hierarchie;
• unklare Unterscheidung zwischen Modus, Zustand und Fehler;
• Übergänge, die durch verrauschte Signale ohne Entprellung oder Validierung ausgelöst werden;
• Fehlerzustände, die das Ausgangsverhalten nicht definieren;
• Wiederherstellungspfade, die einen unsicheren oder unbeabsichtigten Neustart erlauben;
• Ausgangslogik, die stillschweigend verstreute Abhängigkeiten wieder einführt.

Ein schlechter Zustandsautomat ist immer noch einfacher zu diagnostizieren als schlechte Zwiebellogik, aber das ist nicht dasselbe wie zu sagen, er sei gut. Architektur verbessert Ihre Chancen; sie hebt die ingenieurtechnische Disziplin nicht auf.

Das praktische Fazit ist, dass explizite Zustandsautomaten in der Regel die bessere Architektur sind, wenn Sequenzklarheit, Fehlerbehebung und Sichtbarkeit bei der Inbetriebnahme wichtig sind.

Wenn die Maschine mehrere Phasen, Verriegelungen, anormale Bedingungen oder Wiederherstellungsanforderungen hat, wird ein einzelnes maßgebliches Zustandsmodell in der Regel die schichtbasierte Latch-Logik in Bezug auf Wartbarkeit und Diagnostizierbarkeit übertreffen. Das gilt insbesondere für Junior- und Intermediate-Ingenieure, die eine Architektur benötigen, über die sie unter Druck nachdenken können.

OLLA Lab fügt sich als begrenzte Validierungsumgebung in diesen Workflow ein. Es ermöglicht Ingenieuren, Ladder-Logik zu erstellen, E/A zu beobachten, den Zustand gegen simuliertes Ausrüstungsverhalten zu vergleichen, Fehler zu injizieren und die Sequenz zu überarbeiten, bevor ein Live-Einsatzkontext existiert. Das ist ein ernsthafter Anwendungsfall. Kein Feuerwerk erforderlich.

- Für eine tiefere Aufschlüsselung des Latch-Verhaltens lesen Sie „Seal-In“ vs. „Latch“: Warum professionelle Ingenieure sorgfältig wählen. - Um zu sehen, wie diese Architektur auf einen kontinuierlichen Prozess angewendet wird, folgen Sie Schritt-für-Schritt-Aufbau: Der automatisierte Mischer-Zustandsautomat.

• Die Beherrschung der Zustandsarchitektur ist eine Kernkompetenz in unserem Ladder Logic Mastery Hub.
• Hören Sie auf zu raten, wie Ihre Logik mit einem Sensorausfall umgeht. Öffnen Sie das Förderband-Stau-Szenario im OLLA Lab.

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